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74S00 QUAD 2-input NAND GATE ![]() ![]() ETC |
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74S08 Quad 2-Input AND Gates DM54S08 DM74S08 Quad 2-Input AND Gates
DM54S08 DM74S08 Quad 2-Input AND Gates
General Description
This device contains four independent gates each of which performs the logic AND function
Connection Diagram
Dual-In-Line Package
June 1989
Function Table
Order Number DM54S08J DM54S08W or DM74S0 ![]() National Semiconductor ![]() |
74S08 Quadruple 2-Input Positive-AND Gates ![]() Texas Instruments ![]() |
74S08N Quad 2-Input AND Gate DM74S08 Quad 2-Input AND Gate
March 1996 Revised April 2000
DM74S08 Quad 2-Input AND Gate
General Description
This device contains four independent gates each of which performs the logic AND function.
Ordering Code:
Order Number Package Number
Package Description
DM74S08N
N14A
14-Lead Plasti ![]() Fairchild Semiconductor ![]() |
74S10 STTL type three 3-input NAND gate 54S10, 74S10 STTL 型三 3 入 非 典型 : tpd=3ns Pd=19mW, 每 路 (1, 3)
符
式: 外引 排列 : 表:
入 B H × L × 出 Y L H H H
A H L × ×
C H × × L
推 工作 件
74Ⅱ 符 Vcc VIH VIL IOH IOL TA 名 最小 源 入高 平 入低 平 出高 平 流 � ![]() TW ![]() |
74S112 Dual Negative-Edge-Triggered Master-Slave J-K Flip-Flop DM74S112 Dual Negative-Edge-Triggered Master-Slave J-K Flip-Flop with Preset, Clear, and Complementary Outputs
August 1986 Revised April 2000
DM74S112 Dual Negative-Edge-Triggered Master-Slave J-K Flip-Flop with Preset, Clear, and Complementary Outputs
General Description
This device contains two ![]() Fairchild Semiconductor ![]() |
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